【校招Verilog手撕代码】VL8、握手过程(ready-valid)

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理论

握手过程主要用于上下游模块之间的交互。

握手信号,就是为了模块之间的数据交互正确才衍生出来的信号。其无非就是三种可能

1、上游master提供的valid 信号随数据一起拉高,但下游slave过一段时间才准备好的valid先高为敬。

在这里插入图片描述

2、下游slave一直准备好,但上游数据过段时间才有效的ready先高为敬。

在这里插入图片描述

3、上游master的valid信号和下游slave的ready同时为高。

在这里插入图片描述

代码

在这里插入图片描述

RTL

module ready_valid(


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